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FPGA在出租車計(jì)費(fèi)器上的應(yīng)用研究
針對傳統(tǒng)基于單片機(jī)的出租車計(jì)費(fèi)器的不足之處,給出了一種利用VHDL硬件描述語言設(shè)計(jì)基于FPGA的出租車計(jì)費(fèi)系統(tǒng)的方案.該系統(tǒng)具有模擬出租車啟動(dòng),停止,暫停等功能,并用動(dòng)態(tài)掃描電路顯示出租車行駛里程、等待時(shí)間和所需的費(fèi)用.通過分析軟件仿真的波形和硬件調(diào)試,證明該出租車計(jì)費(fèi)系統(tǒng)具有出租車計(jì)費(fèi)囂的基本功能.由于使用FPGA芯片,具有外圍電路少,成本低等優(yōu)點(diǎn),可用于實(shí)際的出租車計(jì)費(fèi)系統(tǒng).
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